//`include "mux_using_procedure.v"
`include "mux_using_case.v"
module testbench();
reg a; // input 0
reg b; // input 1
reg s; // input select
wire c; // output
initial begin
$dumpfile("sim.vcd");
$dumpvars(0, testbench);
$monitor("TIME=%d A=%b B=%b SEL=%b C=%b", $time, a, b, s, c);
// test scenario
a <= 1'b0; b <= 1'b0; s <= 1'b0;
#2 a <= 1'b0; b <= 1'b0; s <= 1'b1;
#2 a <= 1'b0; b <= 1'b1; s <= 1'b0;
#2 a <= 1'b0; b <= 1'b1; s <= 1'b1;
#2 a <= 1'b1; b <= 1'b0; s <= 1'b0;
#2 a <= 1'b1; b <= 1'b0; s <= 1'b1;
#2 a <= 1'b1; b <= 1'b1; s <= 1'b0;
#2 a <= 1'b1; b <= 1'b1; s <= 1'b1;
#2 $finish();
end
// connect DUT to testbench
mux dut_mux(
.iA(a),
.iB(b),
.iSel(s),
.oC(c)
);
endmodule
댓글을 달아 주세요
MUX using case 21번 line
1'b0: oC = iA; -> 1'b0: oC = iB;
오타 수정 요망... ^^
감사합니다. 덕분에 고쳤습니다.
아 이 코드 생각나네요 ㅋㅋㅋ 예전에 제가 막 징징거리니까
이게 기본인데... 라고 하셨었는데 이제야 이해가 ㅋㅋㅋㅋㅋㅋㅋㅋㅋㅋㅋㅋㅋㅋ
아 좀 막연히 겁먹지 말고 봤었으면 그때 그렇게 징징거리지도않았을텐데 ㅋㅋㅋㅋㅋㅋㅋ